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7.8 KiB
C
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C
/*
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* Copyright (C) 2012-2013 Apple Inc. All rights reserved.
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* It is considered confidential and proprietary.
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* Apple Inc.
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*/
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#include <stdint.h>
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#include <drivers/apple/gpio.h>
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#include <platform/soc/hwregbase.h>
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/* Default t7001padsim Pin Configuration - Capri I/O Spreadsheet v10.29 */
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static const uint32_t gpio_default_cfg[GPIO_GROUP_COUNT * GPIOPADPINS] = {
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/* Port 0 */
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CFG_IN, // MENU_KEY_L -> REQUEST_DFU2
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CFG_IN, // HOLD_KEY_L -> REQUEST_DFU1
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CFG_DISABLED, // ISP0_SDA ->
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|
CFG_DISABLED, // ISP0_SCL ->
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CFG_DISABLED, // ISP1_SDA ->
|
|
CFG_DISABLED, // ISP1_SCL ->
|
|
CFG_DISABLED, // SENSOR0_RST ->
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|
CFG_DISABLED, // SENSOR0_CLK ->
|
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/* Port 1 */
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CFG_DISABLED, // SENSOR0_XSHUTDOWN ->
|
|
CFG_DISABLED, // SENSOR0_ISTRB ->
|
|
CFG_DISABLED, // SENSOR1_RST ->
|
|
CFG_DISABLED, // SENSOR1_CLK ->
|
|
CFG_DISABLED, // SENSOR1_XSHUTDOWN ->
|
|
CFG_DISABLED, // SENSOR1_ISTRB ->
|
|
CFG_DISABLED, // UART3_TXD ->
|
|
CFG_DISABLED, // UART3_RXD ->
|
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/* Port 2 */
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CFG_DISABLED, // NULL ->
|
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CFG_DISABLED, // NULL ->
|
|
CFG_DISABLED, // NULL ->
|
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CFG_DISABLED, // NULL ->
|
|
CFG_DISABLED, // NULL ->
|
|
CFG_DISABLED, // NULL ->
|
|
CFG_DISABLED, // NULL ->
|
|
CFG_DISABLED, // NULL ->
|
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/* Port 3 */
|
|
CFG_DISABLED, // NULL ->
|
|
CFG_DISABLED, // NULL ->
|
|
CFG_DISABLED, // NULL ->
|
|
CFG_DISABLED, // NULL ->
|
|
CFG_DISABLED, // NULL ->
|
|
CFG_DISABLED, // NULL ->
|
|
CFG_DISABLED, // NULL ->
|
|
CFG_DISABLED, // NULL ->
|
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/* Port 4 */
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CFG_DISABLED, // UART3_RTSN ->
|
|
CFG_DISABLED, // UART3_CTSN ->
|
|
CFG_DISABLED, // UART5_RTXD ->
|
|
CFG_DISABLED, // DWI0_DO ->
|
|
CFG_DISABLED, // DWI0_CLK ->
|
|
CFG_DISABLED, // I2C0_SDA ->
|
|
CFG_DISABLED, // I2C0_SCL ->
|
|
CFG_DISABLED, // I2S0_LRCK ->
|
|
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/* Port 5 */
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|
CFG_DISABLED, // I2S0_BCLK ->
|
|
CFG_DISABLED, // I2S0_DOUT ->
|
|
CFG_DISABLED, // I2S0_DIN ->
|
|
CFG_DISABLED, // I2S1_MCK ->
|
|
CFG_DISABLED, // I2S1_LRCK ->
|
|
CFG_DISABLED, // I2S1_BCLK ->
|
|
CFG_DISABLED, // I2S1_DOUT ->
|
|
CFG_DISABLED, // I2S1_DIN ->
|
|
|
|
/* Port 6 */
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|
CFG_DISABLED, // SPI3_MOSI ->
|
|
CFG_DISABLED, // SPI3_MISO ->
|
|
CFG_DISABLED, // SPI3_SCLK ->
|
|
CFG_DISABLED, // SPI3_SSIN ->
|
|
CFG_DISABLED, // TMR32_PWM0 ->
|
|
CFG_DISABLED, // TMR32_PWM1 ->
|
|
CFG_DISABLED, // TMR32_PWM2 ->
|
|
CFG_DISABLED, // DISP_VSYNC ->
|
|
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|
/* Port 7 */
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|
CFG_FUNC0, // WDOG ->
|
|
CFG_DISABLED, // SOCHOT0 ->
|
|
CFG_DISABLED, // SOCHOT1 ->
|
|
CFG_DISABLED, // CPU_SLEEP_STATUS ->
|
|
CFG_DISABLED, // TST_CLKOUT ->
|
|
CFG_DISABLED, // ISP_UART0_TXD ->
|
|
CFG_DISABLED, // ISP_UART0_RXD ->
|
|
CFG_DISABLED, // UART7_TXD ->
|
|
|
|
/* Port 8 */
|
|
CFG_DISABLED, // UART7_RXD ->
|
|
CFG_DISABLED, // I2C1_SDA ->
|
|
CFG_DISABLED, // I2C1_SCL ->
|
|
CFG_FUNC0, // SPI0_SCLK -> BOARD_ID0
|
|
CFG_FUNC0, // SPI0_MOSI -> BOARD_ID1
|
|
CFG_FUNC0, // SPI0_MISO -> BOARD_ID2
|
|
CFG_OUT_1, // SPI0_SSIN ->
|
|
CFG_DISABLED, // I2S3_MCK ->
|
|
|
|
/* Port 9 */
|
|
CFG_DISABLED, // I2S3_LRCK ->
|
|
CFG_DISABLED, // I2S3_BCLK ->
|
|
CFG_DISABLED, // I2S3_DOUT ->
|
|
CFG_DISABLED, // I2S3_DIN ->
|
|
CFG_DISABLED, // UART4_TXD ->
|
|
CFG_DISABLED, // UART4_RXD ->
|
|
CFG_DISABLED, // UART4_RTSN ->
|
|
CFG_DISABLED, // UART4_CTSN ->
|
|
|
|
/* Port 10 */
|
|
CFG_DISABLED, // GPIO0 ->
|
|
CFG_DISABLED, // GPIO1 ->
|
|
CFG_DISABLED, // GPIO2 ->
|
|
CFG_DISABLED, // GPIO3 ->
|
|
CFG_DISABLED, // GPIO4 ->
|
|
CFG_DISABLED, // GPIO5 ->
|
|
CFG_DISABLED, // GPIO6 ->
|
|
CFG_DISABLED, // GPIO7 ->
|
|
|
|
/* Port 11 */
|
|
CFG_DISABLED, // GPIO8 ->
|
|
CFG_DISABLED, // GPIO9 ->
|
|
CFG_DISABLED, // GPIO10 ->
|
|
CFG_DISABLED, // GPIO11 ->
|
|
CFG_DISABLED, // GPIO12 ->
|
|
CFG_DISABLED, // GPIO13 ->
|
|
CFG_DISABLED, // GPIO14 ->
|
|
CFG_DISABLED, // GPIO15 ->
|
|
|
|
/* Port 12 */
|
|
CFG_DISABLED, // GPIO16 -> BOARD_ID3
|
|
CFG_DISABLED, // GPIO17 ->
|
|
CFG_DISABLED, // GPIO18 -> BOOT_CONFIG0
|
|
CFG_DISABLED, // GPIO19 ->
|
|
CFG_DISABLED, // GPIO20 ->
|
|
CFG_DISABLED, // GPIO21 ->
|
|
CFG_DISABLED, // GPIO22 ->
|
|
CFG_DISABLED, // GPIO23 ->
|
|
|
|
/* Port 13 */
|
|
CFG_DISABLED, // GPIO24 ->
|
|
CFG_DISABLED, // GPIO25 -> BOOT_CONFIG1
|
|
CFG_IN, // GPIO26 -> FORCE_DFU
|
|
CFG_DISABLED, // GPIO27 -> DFU_STATUS
|
|
CFG_DISABLED, // GPIO28 -> BOOT_CONFIG2
|
|
CFG_DISABLED, // GPIO29 -> BOARD_ID4
|
|
CFG_DISABLED, // GPIO30 ->
|
|
CFG_DISABLED, // GPIO31 -> BOOT_CONFIG3
|
|
|
|
/* Port 14 */
|
|
CFG_DISABLED, // GPIO32 ->
|
|
CFG_DISABLED, // GPIO33 ->
|
|
CFG_DISABLED, // GPIO34 ->
|
|
CFG_DISABLED, // GPIO35 ->
|
|
CFG_DISABLED, // GPIO36 ->
|
|
CFG_DISABLED, // GPIO37 ->
|
|
CFG_DISABLED, // SPI2_SCLK ->
|
|
CFG_DISABLED, // SPI2_MOSI ->
|
|
|
|
/* Port 15 */
|
|
CFG_DISABLED, // SPI2_MISO ->
|
|
CFG_DISABLED, // SPI2_SSIN ->
|
|
CFG_DISABLED, // UART8_TXD ->
|
|
CFG_DISABLED, // UART8_RXD ->
|
|
CFG_DISABLED, // NULL ->
|
|
CFG_DISABLED, // NULL ->
|
|
CFG_DISABLED, // NULL ->
|
|
CFG_DISABLED, // NULL ->
|
|
|
|
/* Port 16 */
|
|
CFG_FUNC0, // UART0_TXD ->
|
|
CFG_FUNC0, // UART0_RXD ->
|
|
CFG_DISABLED, // UART6_TXD ->
|
|
CFG_DISABLED, // UART6_RXD ->
|
|
CFG_DISABLED, // I2C2_SDA ->
|
|
CFG_DISABLED, // I2C2_SCL ->
|
|
CFG_DISABLED, // I2C3_SDA ->
|
|
CFG_DISABLED, // I2C3_SCL ->
|
|
|
|
/* Port 17 */
|
|
CFG_DISABLED, // UART2_TXD ->
|
|
CFG_DISABLED, // UART2_RXD ->
|
|
CFG_DISABLED, // UART2_RTSN ->
|
|
CFG_DISABLED, // UART2_CTSN ->
|
|
CFG_DISABLED, // UART1_TXD ->
|
|
CFG_DISABLED, // UART1_RXD ->
|
|
CFG_DISABLED, // UART1_RTSN ->
|
|
CFG_DISABLED, // UART1_CTSN ->
|
|
|
|
/* Port 18 */
|
|
CFG_DISABLED, // EDP_HPD ->
|
|
CFG_DISABLED, // I2S4_MCK ->
|
|
CFG_DISABLED, // I2S4_LRCK ->
|
|
CFG_DISABLED, // I2S4_BCLK ->
|
|
CFG_DISABLED, // I2S4_DOUT ->
|
|
CFG_DISABLED, // I2S4_DIN ->
|
|
CFG_DISABLED, // I2S2_LRCK ->
|
|
CFG_DISABLED, // I2S2_BCLK ->
|
|
|
|
/* Port 19 */
|
|
CFG_DISABLED, // I2S2_DOUT ->
|
|
CFG_DISABLED, // I2S2_DIN ->
|
|
CFG_DISABLED, // SPI1_SCLK ->
|
|
CFG_DISABLED, // SPI1_MOSI ->
|
|
CFG_DISABLED, // SPI1_MISO ->
|
|
CFG_DISABLED, // SPI1_SSIN ->
|
|
CFG_DISABLED, // CLK32K_OUT ->
|
|
CFG_DISABLED, // ULPI_DIR ->
|
|
|
|
/* Port 20 */
|
|
CFG_DISABLED, // ULPI_STP ->
|
|
CFG_DISABLED, // ULPI_NXT ->
|
|
CFG_DISABLED, // ULPI_DATA7 ->
|
|
CFG_DISABLED, // ULPI_DATA6 ->
|
|
CFG_DISABLED, // ULPI_DATA5 ->
|
|
CFG_DISABLED, // ULPI_DATA4 ->
|
|
CFG_DISABLED, // ULPI_CLK ->
|
|
CFG_DISABLED, // ULPI_DATA3 ->
|
|
|
|
/* Port 21 */
|
|
CFG_DISABLED, // ULPI_DATA2 ->
|
|
CFG_DISABLED, // ULPI_DATA1 ->
|
|
CFG_DISABLED, // ULPI_DATA0 ->
|
|
CFG_DISABLED, // DWI1_DO ->
|
|
CFG_DISABLED, // DWI1_CLK ->
|
|
CFG_DISABLED, // PCIE_CLKREQ0_N ->
|
|
CFG_DISABLED, // PCIE_CLKREQ1_N ->
|
|
CFG_DISABLED, // PCIE_CLKREQ2_N ->
|
|
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|
/* Port 22 */
|
|
CFG_DISABLED, // PCIE_CLKREQ3_N ->
|
|
CFG_DISABLED, // NAND_SYS_CLK ->
|
|
CFG_DISABLED, // PCIE_PERST0_N ->
|
|
CFG_DISABLED, // PCIE_PERST1_N ->
|
|
CFG_DISABLED, // PCIE_PERST2_N ->
|
|
CFG_DISABLED, // PCIE_PERST3_N ->
|
|
CFG_DISABLED, // I2S0_MCK ->
|
|
CFG_DISABLED, // I2S2_MCK ->
|
|
};
|
|
|
|
const uint32_t *target_get_default_gpio_cfg(uint32_t gpioc)
|
|
{
|
|
return gpio_default_cfg;
|
|
}
|